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电路设计的误区,这样的坑你们踩过几个?

admin2020-11-0718

导语


电路设计并不是想固然,你脑子一拍就可以设计出来,有没有履历设计出来的器械是相差千里。今天我们来看看电子工程师会泛起的下面的几个误区,你是不是也这样想的。


电路设计的误区,这样的坑你们踩过几个? 第1张
电路设计的误区,这样的坑你们踩过几个? 第2张

误区一:这板子的PCB设计要求不高,就用细一点的线,自动布吧。

点评:自动布线一定要占用更大的PCB面积,同时发生比手动布线多好多倍的过孔,在批量很大的产物中,PCB厂家降价所思量的因素除了商务因素外,就是线宽和过孔数目,它们划分影响到PCB的成品率和钻头的消耗数目,节约了供应商的成本,也就给降价找到了理由。


电路设计的误区,这样的坑你们踩过几个? 第2张

误区二:这些总线信号都用电阻拉一下,感受放心些。

点评:信号需要上下拉的缘故原由许多,但也不是个个都要拉。上下拉电阻拉一个单纯的输入信号,电流也就几十微安以下,但拉一个被驱动了的信号,其电流将达毫安级,现在的系统常常是地址数据各32位,可能另有244/245 隔离后的总线及其它信号,都上拉的话,几瓦的功耗就耗在这些电阻上了。

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误区三:CPU 和FPGA的这些不用的I/O口怎么处置呢?先让它空着吧,以后再说。

点评:不用的I/O口若是悬空的话,受外界的一点点滋扰就可能成为频频振荡的输入信号了,而MOS器件的功耗基本取决于门电路的翻转次数。若是把它上拉的话,每个引脚也会有微安级的电流,以是最好的设施是设成输出(固然外面不能接其它有驱动的信号)。


误区四:这款FPGA还剩这么多门用不完,可恣意施展吧。

点评:FGPA的功耗与被使用的触发器数目及其翻转次数成正比,以是统一型号的FPGA在差别电路差别时刻的功耗可能相差100倍。只管削减高速翻转的触发器数目是降低FPGA功耗的基本方式。


误区五:这些小芯片的功耗都很低,不用思量。

点评:对于内部不太庞大的芯片功耗是很难确定的,它主要由引脚上的电流确定,一个ABT16244,没有负载的话耗电也许不到1毫安,但它的指标是每个脚可驱动60毫安的负载(如匹配几十欧姆的电阻),即满负荷的功耗最大可达60*16=960mA ,固然只是电源电流这么大,热量都落到负载身上了。

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